No hay explicaciones sobre el propósito del circuito y el tipo de implementación.
El diseño es difícil, porque la frecuencia de la onda cuadrada es muy alta: 1 o 0.5 GHz. Además, supongo que las líneas de retraso introducen retrasos mucho más pequeños que 1 ns.
Si la frecuencia de la onda cuadrada fuera mucho más baja, podría implementar las líneas de retardo con líneas de retardo tocadas muestreadas a una frecuencia mucho más alta que la del reloj flip-flop. En este escenario, podría usar un diseño sincrónico. Sin embargo, este enfoque no sería práctico en su caso.
Dado que la frecuencia es muy alta y el retraso de las líneas de retraso es muy pequeño, debe diseñar un circuito asíncrono. Debe usar puertas para implementar los retrasos. Sin embargo, la demora introducida por una puerta depende de varios factores: tecnología, suministro de voltaje, temperatura y abanico. Debe introducir algunos comentarios para asegurarse de que el retraso no cambie debido a los cambios de temperatura y voltaje.
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El circuito es básicamente analógico, por lo que debe usar SPICE para simularlo.