SystemVerilog es un lenguaje lento, costoso y pobre, dirigido a una pequeña comunidad de personas mayormente no lingüísticas. SV tiene compiladores incorrectos que prefieren errores de tiempo de ejecución a errores de tiempo de compilación. Los proveedores de CAE querían un bloqueo en este mercado, por lo que nunca admitieron una biblioteca y metodología de C ++ de código abierto. Buena suerte.
De acuerdo, no es el mejor idioma de la tierra.
Pero si va a hacer un proyecto, elija un diseño simple para construir un entorno. Luego, considere cómo va a controlar la entrada estimulante para el diseño y observe la salida del diseño. Y finalmente, considere cómo sabrá cuándo sus observaciones son correctas.
Usando esa información, cree un entorno:
1. Control : Diseñar y construir controladores, secuencias que
2. Observar : diseñar y construir monitores
3. Confirmar : diseñar y construir un marcador y un predictor
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El predictor suele ser la parte más complicada.
Comience con la implementación del control para que pueda tener una buena sensación de que su proyecto está en marcha y que su diseño se ejecutará. Y luego sigue adelante. Si puede hacer un sistema completo, eso sería lo mejor. Si solo llega a la parte de control, eso no es un mal comienzo. Buena suerte.