Un típico sumador completo de 1 bit se muestra en la siguiente imagen.
La forma clásica de implementar un sumador de N bits es usar N 1 bits de sumadores completos en paralelo. Por ejemplo, para un sumador de 4 bits se necesitan cuatro sumadores completos de 1 bit.
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El sumador agrega las dos entradas A y B en paralelo produciendo la suma S. Suponiendo que A y B se almacenan en dos registros de entrada y S se almacena en un registro de salida, el sumador puede realizar la suma en un solo ciclo de reloj.
El mismo sumador se puede implementar con una técnica de serie de bits. El circuito consta de tres registros de desplazamiento (no se muestran en la imagen), un FF y un sumador completo de 1 bit. Para la implementación en serie de bits, se necesitan N ciclos del reloj para realizar la misma adición.
Antes de cada adición, las entradas A y B deben cargarse en dos registros de desplazamiento. Los registros de desplazamiento de entrada desplazan las entradas un bit a la vez comenzando desde el LSB. El sumador completo de 1 bit agrega Ai con Bi y produce un bit de suma y un bit de ejecución. El bit de ejecución se almacena en un FF y se usa en el siguiente ciclo de reloj. Los bits de la suma se desplazan en un registro de desplazamiento de salida. Después de N ciclos de reloj, el resultado está contenido en el registro de salida.